1. 代码要表格化,便于阅读
2. 代码用空格对齐,用空格代替tab
3. 一行一个表达式
4.每行写一个端口申明
5. 端口申明的顺序要和模块申明时保持一致
6. 内部的线必须显示申明, 最好在端口申明后一起做申明
7. 一行不要超过80个字符
8.没有特殊必要,不同的时钟要放在不同的模块
9. 不能有组合的环路
10.所有的寄存器都需要初始化
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【硬件描述语言HDL的现状与发展 】
来源: 编辑: 日期:2007-1-20 20:52:45
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